RISC RISC-V处理器是架构发明者Krste Asanovic 教授带领团队开发的一个完全开放的、标准的、能够支持各种应用的新指令集，他也得到了RISC的发明者之一，Dave Patterson教授的大力支持。从2010年夏天开始，大约花了四年的时间，这个团队设计和开发了一套完整的新的指令集，同时也包含了移植好的编译器、工具链、仿真器，并经过数次流片验证。为了能够加快开发的效率，以便能够快速的评估和修改设计以及提高可复用性，Chisel作为一种新的硬件构建语言也被开发了出来。简言之，你可以用scala这种函数式编程语言去设计硬件，并最终能够生成传统的Verilog HDL用于ASIC/FPGA，或者生成C++用于仿真。

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